J-K触发器和D式
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发布时间：2024-10-24 05:18
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时间：2024-11-08 11:23
本文主要介绍了两种常见的触发器：J-K触发器和D触发器，它们在逻辑功能和触发方式上有所不同。
J-K触发器的逻辑特性是，当J和K同时为1时，输出状态会反转。这种触发器没有一次变化现象，输入信号可以在CP触发沿之前加入。为了确保J和K信号先于CP信号，需要考虑信号传输的延迟时间。J-K触发器具有置0和置1的能力。
D触发器则以CP（时钟脉冲）的正跳变0→1前沿为触发点，触发器的新状态由CP上升沿前D端的状态决定，可以实现置位和置0功能。D触发器的电路通常包括4个与非门，其中G1和G2构成基本RS触发器。电平触发的D触发器需在正跳沿前稳定输入，边沿触发器则允许在触发沿前加入信号，提高了抗干扰性。
触发器作为具有记忆功能的存储元件，在时序逻辑电路中广泛应用，包括RS、JK、D和T等多种类型，按触发方式又分为主从和边沿触发器。我国生产的TTL集成触发器如边沿D和JK触发器，以及主从JK触发器，可通过转换实现不同功能，但触发方式保持不变。
